Hard Processor System 側 SDRAM の ModelSimシミュレーション方法

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設計 FPGA/CPLD/ASIC Intel

この資料は、アルテラ社 SoC FPGA デバイスの Hard Processor System (HPS) 側に実装されている HPS Hard Memory Controller を ModelSim を使用してシミュレーションする方法について記載します。

ここでは、ModelSim-Altera を使用していますが、ModelSim-SE 等でも同様にシミュレーションが可能です。

＜対応バージョン＞

Quartus II v14.0

ModelSim-Altera 10.1e

＜内容＞

1. はじめに

2. シミュレーション手順

　2-1. Qsys でのハードウェア作成とテストベンチ生成

　2-2. シミュレーションに必要なファイルの作成

　2-3. ModelSim-Altera の起動からシミュレーションの実行まで

3. 詳細

　3-1. test_program.sv

　3-2. top.sv

　3-3. load_sim.tcl