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FPGA 内部の Global Clock を PLL へのリファレンス・クロックにすると Critical Warning が表示されるのですが、何か問題となるでしょうか？
Quartus Prime
クロック/PLL
PLL へは専用クロック・ピンからの内部専用配線経由での入力が推奨となっているので、Global Clock からの入力の場合は Critical Warning が表示されます。
Global Clock からの入力の場合、Critical Warning メッセージにも記載されていると思いますが、ジッターが付加されるためタイミングに影響が出る可能性が考えられるので、できるだけ PLL へは専用クロック・ピンからの内部専用配線経由での入力を推奨します。
経験豊富なFAEが