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Intel：Cyclone® V と DDRx の接続で終端抵抗の配置場所や終端抵抗までのトレース長の規定はありますか？
ボード
カテゴリ：外部メモリ・インタフェース
ツール：－
デバイス：Cyclone® V
特定の推奨配線はありません。
分岐前のメモリ側で終端後、分岐し各チップに等長配線することも可能ですし、分岐後に各メモリごとに終端を設けることも可能です。
ただし、いずれの配線を選択したとしても基板シミュレーションを実施し問題がないことを確認していただく必要があります。
各トレース長については下記 External Memory Interface (EMIF) Handbook に記載がありますので、ご確認ください。
External Memory Interface Handbook Volume 2: Design Guidelines
https://www.intel.com/content/dam/www/programmable/us/en/pdfs/literature/hb/external-memory/emi_plan.pdf
（DDR2 SDRAM Layout Guidelines で検索してください。）
経験豊富なFAEが