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Intel：Cyclone® V SoC の hpsinfo レジスタの dualcore ビットをリードすると 1 が立っていて dual-core となっていることが確認できますが、これを動的に 0 (Not dual-core) とするためにはどのようにすれば良いですか？
SoC FPGA
カテゴリ：SoC
ツール：SoC EDS
デバイス：Cyclone® V
hpsinfo レジスタ/ビットは動作中のコア数を示しているわけではなく、デバイスに実装されているコア数を示します。
このため、デュアル・コア品を使用している場合には、常にデュアル・コアとして表示されます。
経験豊富なFAEが