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この資料は、ModelSim®-Altera® を使用した RTL シミュレーションの方法を説明しています。

FPGA/CPLD の開発フローについては、こちら を参照してください。

説明

ModelSim®-Altera® では、論理合成前の "RTL シミュレーション" を行うことができます。初めて ModelSim®-Altera® を使用する方におすすめの資料です。

資料

このドキュメントは、v15.1(ModelSim®-Altera® 10.4b)用から Verilog-HDL と VHDL 向け資料を統合しました。

ModelSim® - Intel® FPGA Edition - RTL シミュレーションの方法

ELS1283_Q1112_10__1.pdf

ツール・バージョン:Ver.11.1(ModelSim-Altera 10.0c)用ドキュメント

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